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名称 计算机原理与设计 : Verilog HDL版
索引号 TP3/201211
分类号 TP3
TP3(计算技术、计算机技术)
TP(自动化技术计算技术技术)
T(工业技术)
作者 李亚民、
出版社 北京 : 清华大学出版社, 2011
ISBN 978-7-302-25109-5
页数 xv, 520页 : 图 ; 26cm
价格 CNY49.00
标签 嵌入式、verilog、cpu、微电子、电路设计中国技术、计算机、计算机技术、
简介
注解 有书目 (第503-504页) 和索引 本书讲述计算机原理、计算机设计以及如何用verilog hdl实现设计。主要内容包括: 计算机基础知识及性能评价方法; 数字电路及verilog hdl简介; 计算机加、减、乘、除及开方的各种算法 (包括wallace tree快速乘法器和newton-raphson及goldschmidt除法和开方算法) 及其verilog hdl实现; 指令系统结构和alu及多端口寄存器堆的verilog hdl设计; 单周期、多周期和流水线cpu的verilog hdl设计; 精确中断和异常处理及其电路实现; 浮点算法及带有浮点部件fpu的流水线cpu的verilog hdl设计; 多线程cpu的verilog hdl设计; 存储器、cache和虚拟存储器管理以及带有cache、tlb和fpu的cpu设计; 多核cpu的verilog hdl设计: 异步通信接口uart、ps/2键盘与鼠标接口、视频图像阵列vga接口、i2c串行总线接口和pci并行总线接口的verilog hdl设计; 高性能计算机及互联网络设计。书中的verilog hdl源代码基本上都附有功能仿真波形, 以便加深对计算机原理的理解和对计算机设计方法的掌握。
书籍简介

《计算机原理与设计:Verilog HDL版》讲述计算机原理、计算机设计以及如何用verilog hdl实现设计。主要内容包括:计算机基础知识及性能评价方法;数字电路及verilog hdl简介;计算机加、减、乘、除及开方的各种算法(包括wallace tree快速乘法器和newton-raphson及goldschmidt除法和开方算法)及其verilog hdl实现;指令系统结构和alu及多端口寄存器堆的verilog hdl设计;单周期、多周期和流水线cpu的verilog hdl设计;精确中断和异常处理及其电路实现;浮点算法及带有浮点部件fpu的流水线cpu的verilog hdl设计;多线程cpu的verilog hdl设计;存储器、cache和虚拟存储器管理以及带有cache、tlb和fpu的cpu设计;多核cpu的verilog hdl设计:异步通信接口uart、ps/2键盘与鼠标接口、视频图像阵列vga接口、i2c串行总线接口和pci并行总线接口的verilog hdl设计;高性能计算机及互联网络设计。书中的verilog hdl源代码基本上都附有功能仿真波形,以便加深对计算机原理的理解和对计算机设计方法的掌握。
《计算机原理与设计:Verilog HDL版》可用作高等院校计算机及信息专业本科生和研究生教材,也可供自学者阅读。